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Vivado2019.2集成开发环境设计流程 环境：Ubuntun16.04+Vivado2019.2 写在开始 Vivado基本设计流程，包括创建新设计工程、创建并添加一个新的设计文件、RTL详细描述和分析(RTL Analysis)、设计综合分析(Synthesis)、设计行为级仿真（Run Behavioral Simulation）、创建实现约束文件XDC、设计实现分(Implementation)析、设计时序仿真(Run Post-Implementatio Timing Simulation)、

[vivado2019.2+verilog]同步复位和异步复位tb仿真及源码 一、sync_reset 1.新建项目 2.Add Design Sources 文件 也可以 之后就是一路ok，finsh就行了。个人习惯在设计文件名后面加上“_top”。 接着就可以在右侧编写verilog程序了， 下面展示一些 内联代码片。 `timescale 1ns / 1ps ////////////////////////////////////////////////////////////////////